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《FPGA設(shè)計(jì)實(shí)戰(zhàn)演練(邏輯篇)》面向廣大的FPGA/CPLD初學(xué)者,從零基礎(chǔ)開始講述FPGA/CPLD以及相關(guān)的基礎(chǔ)知識(shí),并以一個(gè)支持各種入門、進(jìn)階的子母板形式的學(xué)習(xí)套件為實(shí)驗(yàn)平臺(tái),針對(duì)Altera公司的Cyclone Ⅲ器件量身打造的24個(gè)應(yīng)用實(shí)例貫穿其中。實(shí)例講解深入淺出,不僅有基本的Verilog語法講解,也有設(shè)計(jì)思路和背景知識(shí)的詳細(xì)描述; 開發(fā)工具(Quartus Ⅱ+ModelSim)的使用更是手把手、圖文并茂地展示給讀者。

fpga設(shè)計(jì)實(shí)戰(zhàn)演練內(nèi)容介紹

第1章是基礎(chǔ)中的基礎(chǔ),講述可編程器件的一些基本概念、主要應(yīng)用領(lǐng)域、相比于傳統(tǒng)技術(shù)的優(yōu)勢(shì)以及開發(fā)流程。

第2章從最基礎(chǔ)的0和1開始回顧數(shù)字電路的基礎(chǔ),深入探討讀者所關(guān)心的可編程器件的內(nèi)部架構(gòu)和原理。

第3章對(duì)后續(xù)例程中將要使用到的硬件開發(fā)學(xué)習(xí)平臺(tái)進(jìn)行介紹,深入詳細(xì)地剖析整個(gè)實(shí)驗(yàn)平臺(tái)的硬件板級(jí)設(shè)計(jì)。

第4章講述開發(fā)環(huán)境的搭建,解決讀者在學(xué)習(xí)上遇到的最棘手的“軟”問題。

第5章是HDL語言基礎(chǔ),介紹使用最廣泛的Verilog語言的基本語法及優(yōu)良的代碼書寫規(guī)范和風(fēng)格。

第6章手把手地帶領(lǐng)讀者完成11個(gè)最基本的入門實(shí)例。

fpga設(shè)計(jì)實(shí)戰(zhàn)演練

fpga設(shè)計(jì)實(shí)戰(zhàn)演練邏輯篇目錄

第1章 概念掃盲

1.1 FPGA簡單入門

1.2 FPGA應(yīng)用領(lǐng)域

1.3 FPGA的優(yōu)勢(shì)

1.4 開發(fā)流程

思考

第2章 邏輯設(shè)計(jì)基礎(chǔ)

2.1 0和1——精彩世界由此開始

2.2 表面現(xiàn)象揭秘——邏輯關(guān)系

2.3 內(nèi)里本質(zhì)探索——器件結(jié)構(gòu)

思考

第3章 實(shí)驗(yàn)平臺(tái)板級(jí)設(shè)計(jì)

3.1 FPGA板級(jí)電路設(shè)計(jì)五要素

3.1.1 能量供應(yīng)——電源電路

3.1.2 心臟跳動(dòng)——時(shí)鐘電路

3.1.3 狀態(tài)初始——復(fù)位電路

3.1.4 靈活定制——配置電路

3.1.5 自由擴(kuò)展——外設(shè)電路

3.2 FPGA核心板設(shè)計(jì)

3.2.1 讀懂器件手冊(cè)

3.2.2 核心板電路設(shè)計(jì)架構(gòu)

3.2.3 電源電路設(shè)計(jì)

3.2.4 時(shí)鐘和復(fù)位電路設(shè)計(jì)

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